合并單元測(cè)試:插值法與同步法解析
2019-08-06合并單元測(cè)試時(shí)需要對(duì)其額定延遲時(shí)間、角差以及比差等參數(shù)進(jìn)行驗(yàn)證,測(cè)試原理一般采用插值法和同步法。 合并單元將模擬量轉(zhuǎn)化成9-2輸出時(shí),由于裝置硬件固有的特性,在同一個(gè)時(shí)間坐標(biāo)系中,其9-2輸出的波形必然會(huì)滯后模擬...
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合并單元測(cè)試時(shí)需要對(duì)其額定延遲時(shí)間、角差以及比差等參數(shù)進(jìn)行驗(yàn)證,測(cè)試原理一般采用插值法和同步法。 合并單元將模擬量轉(zhuǎn)化成9-2輸出時(shí),由于裝置硬件固有的特性,在同一個(gè)時(shí)間坐標(biāo)系中,其9-2輸出的波形必然會(huì)滯后模擬...
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